**Summary:** Meta is hiring ASIC Design Engineers within our Infrastructure organization to build cutting edge ASICs in fields such as machine learning, video transcoding and network acceleration.-------Meta recrute des ingénieurs de conception ASIC au sein de notre organisation Infrastructure pour créer des ASIC de pointe dans des domaines tels que l’apprentissage automatique, le transcodage vidéo et l’accélération réseau. **Required Skills:** ASIC Engineer, Design | Ingénieur ASIC, conception Responsibilities: 1. Architecture exploration | Exploration architecturale 2. Micro-architecture development | Développement de micro-architecture 3. Soft and hard IP identification, selection and integration. Collaboration with verification and emulation teams in test plan development and debug | Identification, sélection et intégration d’IP souple et dur. Collaboration avec les équipes de vérification et d’émulation dans le développement et le débogage du plan de test 4. Collaboration with implementation team to close the design on timing and power | Collaboration avec l’équipe de mise en œuvre pour finaliser la conception en termes de timing et de puissance **Minimum Qualifications:** Minimum Qualifications: 5. Bachelor's degree in Computer Science, Computer Engineering, relevant technical field, or equivalent practical experience | Baccalauréat en informatique, en ingénierie informatique ou dans un domaine technique pertinent, ou expérience pratique équivalente 6. 8+ years of experience in micro-architecture and RTL development for complex control and data path IPs OR Experience in SoC Micro-architecture, Design and Integration | Plus de 8 ans d’expérience en microarchitecture et développement RTL pour les IP de contrôle et de chemin de données complexes OU expérience en microarchitecture, conception et intégration SoC 7. RTL development using Verilog, System Verilog and HLS | Développement RTL avec Verilog, System Verilog et HLS **Preferred Qualifications:** Preferred Qualifications: 8. Experience in CPU, NOC, Memory and Peripheral Subsystems | Expérience en CPU, NOC, mémoire et sous-systèmes périphériques 9. Experience with Synthesis, Timing Closure and Formal Verification Methodology | Expérience en matière de synthèse, de clôture temporelle et de méthodologie de vérification formelle 10. Master’s or PhD degree in Electrical Engineering, Computer Science or related areas | Maîtrise ou doctorat en génie électrique, en informatique ou dans des domaines connexes 11. Experience in data path development | Expérience dans le développement de chemins de données **Public Compensation:** CA$148,000/year to CA$198,000/year + bonus + equity + benefits **Industry:** Internet